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synced 2025-04-21 12:27:27 +03:00
Connecting some FPGA's free GPIO
This commit is contained in:
@@ -1,4 +1,4 @@
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EESchema Schematic File Version 2 date Fri 08 Oct 2010 11:41:21 AM COT
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EESchema Schematic File Version 2 date Sat 09 Oct 2010 04:08:56 PM COT
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LIBS:power
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LIBS:r_pack2
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LIBS:v0402mhs03
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@@ -53,9 +53,9 @@ LIBS:xue-rnc-cache
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EELAYER 24 0
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EELAYER END
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$Descr A3 16535 11700
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Sheet 4 11
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Sheet 5 12
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Title ""
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Date "8 oct 2010"
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Date "9 oct 2010"
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Rev ""
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Comp ""
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Comment1 ""
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@@ -63,6 +63,46 @@ Comment2 ""
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Comment3 ""
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Comment4 ""
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$EndDescr
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Text HLabel 3200 3950 0 40 BiDi ~ 0
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FPGA_VCCO2_IO_AA18
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Text HLabel 3200 1650 0 40 BiDi ~ 0
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FPGA_VCCO2_IO_AB21
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Text HLabel 3200 2350 0 40 BiDi ~ 0
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FPGA_VCCO2_IO_W18
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||||
Text HLabel 3200 5050 0 40 BiDi ~ 0
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||||
FPGA_VCCO2_IO_AB16
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||||
Text HLabel 3200 5450 0 40 BiDi ~ 0
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||||
FPGA_VCCO2_IO_AB15
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||||
Text HLabel 7200 4650 2 40 BiDi ~ 0
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||||
FPGA_VCCO2_IO_V7
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||||
Text HLabel 7200 3350 2 40 BiDi ~ 0
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||||
FPGA_VCCO2_IO_W6
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||||
Text HLabel 7200 2150 2 40 BiDi ~ 0
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FPGA_VCCO2_IO_W4
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Text HLabel 7200 5050 2 40 BiDi ~ 0
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||||
FPGA_VCCO2_IO_Y10
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||||
Text HLabel 7200 5350 2 40 BiDi ~ 0
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FPGA_VCCO2_IO_Y9
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||||
Text HLabel 3200 5350 0 40 BiDi ~ 0
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FPGA_VCCO2_IO_Y15
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||||
Text HLabel 3200 4550 0 40 BiDi ~ 0
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||||
FPGA_VCCO2_IO_Y16
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||||
Text HLabel 7200 5150 2 40 BiDi ~ 0
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FPGA_VCCO2_IO_W10
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Text HLabel 7200 5450 2 40 BiDi ~ 0
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||||
FPGA_VCCO2_IO_W11
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||||
Text HLabel 3200 6150 0 40 BiDi ~ 0
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||||
FPGA_VCCO2_IO_Y12
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||||
Text HLabel 3200 4450 0 40 BiDi ~ 0
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FPGA_VCCO2_IO_AB14
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Text HLabel 3200 6250 0 40 BiDi ~ 0
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FPGA_VCCO2_IO_AB13
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Text HLabel 7200 6150 2 40 BiDi ~ 0
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FPGA_VCCO2_IO_Y11
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Text HLabel 7200 4750 2 40 BiDi ~ 0
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FPGA_VCCO2_IO_W8
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Text HLabel 7200 3950 2 40 BiDi ~ 0
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FPGA_VCCO2_IO_U9
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Text HLabel 7200 1650 2 40 Input ~ 0
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IS_FRAME
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Text HLabel 7200 1750 2 40 Input ~ 0
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Reference in New Issue
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